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• Caractéristiques de fonctionnement
– Plage de tension : 2,7 V à 5,5 V
– Plage de température ambiante : -40 °C à 105 °C pour le mode HSRUN, -40 °C à 150 °C pour le mode RUN
• Cœur Arm™ Cortex-M4F/M0+, processeur 32 bits
– Prend en charge la fréquence jusqu’à 112 MHz (mode HSRUN) avec 1,25 Dhrystone MIPS par MHz
– Noyau de bras basé sur l’architecture Armv7 et Thumb-2® ISA
– Processeur de signal numérique (DSP) intégré
– Contrôleur d’interruption vectorisé imbriqué configurable (NVIC)
– Unité à virgule flottante (FPU) simple précision
• Interfaces d’horloge
– Oscillateur externe rapide (SOSC) de 4 à 40 MHz avec horloge d’entrée carrée externe jusqu’à 50 MHz DC en mode horloge externe
– Oscillateur RC interne rapide (FIRC) 48 MHz
– Oscillateur RC interne lent (SIRC) 8 MHz
– Oscillateur basse consommation (LPO) 128 kHz
– Jusqu’à 112 MHz (HSRUN) système Phased Lock Loop (SPLL)
– Jusqu’à 20 MHz TCLK et 25 MHz SWD_CLK
– Horloge externe 32 kHz Real Time Counter (RTC_CLKIN)
• Gestion de l’alimentation
– Noyau Arm Cortex-M4F/M0+ basse consommation avec une excellente efficacité énergétique
– Contrôleur de gestion de l’alimentation (PMC) avec plusieurs modes d’alimentation : HSRUN, RUN, STOP, VLPR et VLPS.
Remarque : Les écritures/effacements CSEc (Security) ou EEPROM déclenchent des indicateurs d’erreur en mode HSRUN (112 MHz) car ce cas d’utilisation n’est pas autorisé à s’exécuter simultanément. L’appareil devra passer en mode RUN (80 MHz) pour exécuter les écritures/effacements CSEc (Security) ou EEPROM.
– Déclenchement d’horloge et fonctionnement à faible consommation pris en charge sur des périphériques spécifiques.
• Mémoire et interfaces mémoire
– Jusqu’à 2 Mo de mémoire flash programme avec ECC
– 64 KB FlexNVM pour mémoire flash de données avec émulation ECC et EEPROM.
Remarque : Les écritures/effacements CSEc (Security) ou EEPROM déclenchent des indicateurs d’erreur en mode HSRUN (112 MHz) car ce cas d’utilisation n’est pas autorisé à s’exécuter simultanément. L’appareil devra passer en mode RUN (80 MHz) pour exécuter les écritures/effacements CSEc (Security) ou EEPROM.
– Jusqu’à 256 Ko de SRAM avec ECC
– Jusqu’à 4 Ko de FlexRAM pour une utilisation en tant qu’émulation SRAM ou EEPROM
– Jusqu’à 4 Ko de cache de code pour minimiser l’impact des latences d’accès à la mémoire sur les performances
– QuadSPI avec prise en charge HyperBus™
• Signal analogique mixte
– Jusqu’à deux convertisseurs analogiques-numériques (CAN) 12 bits avec jusqu’à 32 entrées analogiques par module
– Un comparateur analogique (CMP) avec convertisseur numérique-analogique (DAC) 8 bits interne
• Fonctionnalité de débogage
– Le port de débogage JTAG de fil série (SWJ-DP) combine
- Point de surveillance et de trace de débogage (DWT)
– Instrumentation Trace Macrocell (ITM)
– Unité d’interface de port de test (TPIU)
– Unité Flash Patch and Breakpoint (FPB)
• Interface homme-machine (IHM)
– Jusqu’à 156 broches GPIO avec fonctionnalité d’interruption
– Interruption non masquable (NMI)
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Le message est le suivant ObligatoireLe message doit être compris entre 20 et 2000 caractères

Conseils pour obtenir des devis précis de la part des fournisseurs. S’il vous plaît inclure le Suite à votre demande :
1. Renseignements personnels ou commerciaux
2. Fournir une demande de produit très détaillée
3. Demande de MOQ, de prix unitaire, etc.


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